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【Verilog_2】: 设计 n 位乘加器(先乘后加)
阅读量:3942 次
发布时间:2019-05-24

本文共 269 字,大约阅读时间需要 1 分钟。

设计 n 位乘加器(先乘后加)

Design a n-bit multiplier (firstly multiply and then add)`

author : Mr.Maoe-mail : 2458682080@qq.commodule MAC_N#(	parameter N = 16)(	input [N - 1: 0 ] A,	input [N - 1: 0 ] B,	input [N - 1: 0 ] C,	output [2*N - 1 : 0] R);		assign R = A * B + C;endmodule

转载地址:http://uyiwi.baihongyu.com/

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